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更新于 12月11日
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舉報

fpga設(shè)計工程師

1.5萬-2.5萬
  • 北京大興區(qū)
  • 1-3年
  • 本科
  • 全職
  • 招4人

職位描述

Verilog HDL
任職資格：
1、根據(jù)項目需求，完成功能需求分解、實現(xiàn)方法分析及資源使用評估；
2、負責FPGA功能模塊的頂層設(shè)計、代碼編寫、仿真、調(diào)試及測試，解決開發(fā)過程中的各類問題；
3、參與項目的全周期開發(fā)，對所設(shè)計的FPGA模塊進行功能、性能及時序優(yōu)化設(shè)計，使其功能、性能及穩(wěn)定性符合產(chǎn)品要求；
4、完成FPGA模塊的設(shè)計方案、測試報告等相關(guān)文檔的編寫，確保開發(fā)及測試文檔的齊套性；
5、根據(jù)項目需求，完成產(chǎn)品的測試、對接、聯(lián)試、售后維護等相關(guān)工作
崗位要求：
1、統(tǒng)招本科及以上學歷，通信/電子信息工程相關(guān)專業(yè)畢業(yè)，3-5年同崗位工作經(jīng)驗，優(yōu)秀的應屆畢業(yè)生也可接受；
2、熟悉ise，vivado，matlab，modelsim開發(fā)軟件的使用；熟悉片上軟核microblaze的系統(tǒng)搭建和外設(shè)的驅(qū)動設(shè)計；
3、熟悉硬件描述語言設(shè)計，c語言設(shè)計；熟悉軟件無線電有關(guān)的理論、算法設(shè)計；
4、誠實守信，具有較強的責任心以及保密意識。

工作地點

北京大興區(qū)榮華南路15號中航技廣場

職位發(fā)布者

李先生/招聘總監(jiān)

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公司Logo北京融為科技有限公司
北京融為科技有限公司坐落于國家級經(jīng)濟技術(shù)開發(fā)區(qū)——北京亦莊經(jīng)濟技術(shù)開發(fā)區(qū)，主要從事高速數(shù)傳接收設(shè)備、衛(wèi)星測控設(shè)備、彈箭地面遙測設(shè)備、便攜式衛(wèi)星地面終端設(shè)備、無人機數(shù)據(jù)鏈設(shè)備，以及高可靠硬件平臺和板卡的研發(fā)和生產(chǎn)。公司核心人員均來自于中電科院所、清華大學、航天院所及華為，平均從業(yè)時間超過十年，參與過多個國家預研項目研發(fā)及重點型號的研制、交付、任務(wù)執(zhí)行工作，具有豐富的航天設(shè)備研制經(jīng)驗，所開發(fā)的產(chǎn)品具有完整的自主知識產(chǎn)權(quán)，核心算法，程序，硬件平臺，結(jié)構(gòu)等均為自研，目前已完成接近三十多項軟件著作權(quán)申報。北京融為科技有限公司生產(chǎn)的超高速數(shù)字調(diào)制解調(diào)器已在國內(nèi)多家單位廣泛使用（包括中科院空天信息創(chuàng)新研究院、中國電科10所、27所、39所等），并長期用于接收LANDSAT-8, HJ-1B, SPOT-7, HJ-1A, GF-1, GF-2, GF-3, ZY302, KX-03, ZY-02C, SPOT-6、吉林系列衛(wèi)星和珞珈系列衛(wèi)星等，以性能優(yōu)異、運行穩(wěn)定可靠獲得用戶一致好評。
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